SL3000B系列
SL3004B高性能誤碼儀主機(jī)
高性能誤碼儀特點(diǎn)：
單機(jī)設(shè)備支持6個(gè)可擴(kuò)展功能槽位， 靈活配置不同模塊
1GBaud-32.4GBaud,連續(xù)可調(diào)
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支持NRZ/PAM4編碼信令格式
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豐富的抖動(dòng)和哚聲注入功能
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支持高達(dá)1.8V的差分高壓輸出
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支持PRBS隨機(jī)碼、16Gbit用戶自定義碼型
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**的信號(hào)完整性和豐富的**功能
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? 支持NRZ，PAM4編碼信令格式
? 國(guó)內(nèi)**支持主流協(xié)議一致性測(cè)試的**
臺(tái)式誤碼儀， 通過(guò)豐富的低頻抖動(dòng)和高頻
抖動(dòng)注入模擬真實(shí)世界的復(fù)雜環(huán)境
- 周期性SJ抖動(dòng)注入
- 周期性PJ抖動(dòng)注入
- 隨機(jī)抖動(dòng)RJ注入
- 串?dāng)_抖動(dòng)BUJ注入
- 擴(kuò)頻時(shí)鐘SSC注入
- 外部抖動(dòng)注入
? 豐富的各種噪聲注入
- 共模噪聲CMI注入
- 差模噪聲DMI注入
- 寬帶白噪聲BBN注入
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PPG內(nèi)置4個(gè)FFE Taps，
提供靈活的預(yù)失真設(shè)置來(lái)進(jìn)行通道補(bǔ)償
? PPG支持高達(dá)1.8V的差分高壓輸出
? PPG針對(duì)不同的速率支持上升時(shí)間可調(diào)功能
? PPG多通道間支持高達(dá)ps分辨率的相位/Skew調(diào)整功能
? PPG支持多種隨機(jī)碼型和業(yè)內(nèi)*高的**自定義碼型
- PRBS隨機(jī)碼， 高頻/中頻/低頻時(shí)鐘碼
- ≥4Gbit的用戶自定義碼型
? 接收端ED支持**自動(dòng)均衡功能輕松滿足各種復(fù)雜測(cè)試環(huán)境
? 接收端ED內(nèi)置了CDR時(shí)鐘恢復(fù)功能，無(wú)需外部時(shí)鐘輸入
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誤碼儀創(chuàng)建壓力眼來(lái)模擬真實(shí)世界的信號(hào)完整性問(wèn)題
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RX接收機(jī)是整個(gè)高速鏈路的*終環(huán)節(jié)，接收機(jī)測(cè)試由于在芯片內(nèi)部，在絕大多數(shù)場(chǎng)景無(wú)法直接觀測(cè)信號(hào)完整性問(wèn)題。*
主流的方式是通過(guò)創(chuàng)建*的壓力眼來(lái)模擬真實(shí)世界*苛刻的運(yùn)行環(huán)境。誤碼儀是構(gòu)建和校準(zhǔn)壓力眼的核心測(cè)試儀器。
對(duì)于一個(gè)高速傳輸鏈路，接收機(jī)需要能夠在*嚴(yán)苛的環(huán)境中保證能夠可靠的接收傳輸?shù)臄?shù)據(jù)。發(fā)送端和鏈路上的各種信
號(hào)完整性問(wèn)題都會(huì)惡化信號(hào)，減小接收機(jī)的余量。SL3000B系列誤碼儀提供***的RX接收機(jī)壓力眼測(cè)試方案，能夠注
入多達(dá)10種不同類型的抖動(dòng)，噪聲等信號(hào)完整性損傷，模擬真實(shí)世界*嚴(yán)苛復(fù)雜的環(huán)境。
SL3000B系列高性能誤碼儀
SL3004B高性能誤碼儀主機(jī)應(yīng)用
隨著數(shù)字電路工作速度的提高，PCB、連接器、背板上信號(hào)的傳輸速率也越來(lái)越高，其中串行數(shù)據(jù)通信在傳輸中占據(jù)主導(dǎo)
地位。 按照*嚴(yán)格性能標(biāo)準(zhǔn)設(shè)計(jì)的擁有精密設(shè)計(jì)的各種高速互連的PCIE/ETH/VPX背板，以及高速線纜， 在當(dāng)今國(guó)防對(duì)于
高速信號(hào)需求普遍存在的大背景下變得至關(guān)重要。背板是嵌入式系統(tǒng)中的通信主干，必須按照嚴(yán)格的信號(hào)完整性標(biāo)準(zhǔn)進(jìn)
行設(shè)計(jì)，以確保系統(tǒng)內(nèi)模塊之間及時(shí)、準(zhǔn)確的數(shù)據(jù)傳輸。 隨著系統(tǒng)轉(zhuǎn)向支持100G-baseKR4/CR4、PCIe Gen4/5協(xié)議等的更
高串行比特率，高信號(hào)完整性對(duì)于實(shí)現(xiàn)故障**操作至關(guān)重要。要滿足高速傳輸?shù)男阅茴A(yù)期，特別是高速接收機(jī)的性能，
接收機(jī)容限測(cè)試至關(guān)重要。
除此之外高速I(mǎi)EEE ETH以太網(wǎng)主流速率已經(jīng)從10Gbps支持到25Gbps，53Gbps，消費(fèi)電子類的高速總線PCIE、USB3/4的
信號(hào)速率已經(jīng)覆蓋了從2.5Gbps到20Gbps的速率范圍，高速FPGA的串行高速接口速率則從8Gbps猛增到28Gbps，DSP
和ADC/DAC從3Gbps過(guò)度到32Gbps。SL3000B系列高性能誤碼儀能夠針對(duì)各種高速協(xié)議標(biāo)準(zhǔn)和非標(biāo)的速率進(jìn)行接收機(jī)容
限測(cè)試。
高性能誤碼儀典型應(yīng)用領(lǐng)域
? 高速互聯(lián)信號(hào)完整性測(cè)試
? 高速芯片SERDES/FPGA/DAC/ADC的高速接口的接收機(jī)容限和余量測(cè)試
? 高速數(shù)據(jù)中心/光通信/光模塊的研發(fā)測(cè)試
? 激光通信和相干光的研發(fā)測(cè)試
? 各種高速標(biāo)準(zhǔn)和非標(biāo)準(zhǔn)總線的預(yù)先物理層一致性測(cè)試
高性能誤碼儀測(cè)試環(huán)境構(gòu)建
使用誤碼率測(cè)試儀（BERT）進(jìn)行高速串行接口的物理層測(cè)試，可以有效確保高速系統(tǒng)的信號(hào)完整性、可靠性和性能。
以下是詳細(xì)的步驟和方法：
測(cè)試準(zhǔn)備
? 系統(tǒng)分析：熟悉高速串行接口和通信系統(tǒng)的內(nèi)部結(jié)構(gòu)，包括發(fā)送器、接收器、均衡器和PCB布線等，以及鏈路的插損評(píng)估。
? 測(cè)試計(jì)劃：制定詳細(xì)的測(cè)試計(jì)劃，明確測(cè)試目標(biāo)、范圍和所需的設(shè)備。
? 可測(cè)性設(shè)計(jì)： 對(duì)于被測(cè)DUT檢查是否有可測(cè)性設(shè)計(jì)， 設(shè)計(jì)專用或者通用的測(cè)試夾具，
保證BERT誤碼儀能夠通過(guò)測(cè)試夾具把信號(hào)送個(gè)被測(cè)DUT的接收端。
設(shè)置和校準(zhǔn)BERT
? 設(shè)備準(zhǔn)備：準(zhǔn)備BERT、示波器、測(cè)試夾具、連接線纜、衰減器等必要設(shè)備。
? 校準(zhǔn)BERT：對(duì)BERT需要測(cè)試的項(xiàng)目連接示波器或者其他儀器 設(shè)備進(jìn)行校準(zhǔn)。
測(cè)試配置
? PRBS信號(hào)生成：配置BERT生成不同長(zhǎng)度的PRBS信號(hào)（如PRBS7、PRBS15、PRBS31）。
? 數(shù)據(jù)速率設(shè)置：設(shè)置BERT的工作數(shù)據(jù)速率，覆蓋系統(tǒng)的設(shè)計(jì)范圍。
? 設(shè)置撥入經(jīng)過(guò)校準(zhǔn)的幅度/抖動(dòng)/噪聲和通道
BER和JTOL測(cè)試執(zhí)行
? 接收機(jī)RX BER誤碼率測(cè)試：將PRBS信號(hào)通過(guò)發(fā)送器發(fā)送到接收器，并通過(guò)BERT記錄誤碼情況。
? 接收機(jī)RX JTOL抖動(dòng)容限測(cè)試。設(shè)置JTOL的SJ/PJ抖動(dòng)注入的頻率范圍和對(duì)應(yīng)的抖動(dòng)幅度。
? 誤碼計(jì)數(shù)：記錄每個(gè)測(cè)試節(jié)點(diǎn)的誤碼數(shù)量和誤碼率（BER）。
BER和ITOL測(cè)試執(zhí)行
? 接收機(jī)RX ITOL抖動(dòng)容限測(cè)試。設(shè)置JTOL的噪聲抖動(dòng)注入的幅度范圍。
? 誤碼計(jì)數(shù)：記錄每個(gè)噪聲幅度下的誤碼數(shù)量和誤碼率（BER）
BER和串?dāng)_測(cè)試
? 在系統(tǒng)內(nèi)部的關(guān)鍵信號(hào)路徑上分析近端串?dāng)_和遠(yuǎn)端串?dāng)_。
? 通過(guò)多通道誤碼儀注入高速PRBS31信號(hào)，在串?dāng)_條件下運(yùn)行BER測(cè)試，評(píng)估串?dāng)_對(duì)誤碼率的影響。
高速接收機(jī)的抖動(dòng)容限測(cè)試 JTOL
JTOL是評(píng)估高速接收機(jī)能力的經(jīng)典測(cè)試項(xiàng)目，下圖是針對(duì)VSR短距傳輸類型的RX接收端測(cè)試硬件環(huán)境。整個(gè)硬件測(cè)試環(huán)
境的構(gòu)建是為了提供一個(gè)*嚴(yán)苛的測(cè)試環(huán)境，通過(guò)誤碼儀來(lái)注入各種模擬真實(shí)世界的抖動(dòng)，串?dāng)_，物理鏈路來(lái)測(cè)試RX接
收端的誤碼率，得到接收端的余量。
由于絕大多數(shù)RX接收芯片或者模塊都內(nèi)置了時(shí)鐘恢復(fù)電路CDR， 一個(gè)高速鏈路的接收端對(duì)于不同的頻率的抖動(dòng)分量會(huì)
經(jīng)過(guò)CDR后被衰減或者放大。 通過(guò)高速誤碼儀注入不同頻率的周期性抖動(dòng)， 能夠**的測(cè)試出RX接收機(jī)對(duì)于真實(shí)世界
的抖動(dòng)的容忍余量；并且能夠刻畫(huà)出接收端的CDR的環(huán)路響應(yīng)曲線。 無(wú)論是以太網(wǎng)標(biāo)準(zhǔn)為主IEEE 802.3， 以及派生出來(lái)
的RapidIO, OIF-CEI, JESD, RapidIO， 還是以PCIE為主的高速標(biāo)準(zhǔn)， JTOL都是保證高速鏈路可靠性和穩(wěn)定性的必測(cè)物理
層參數(shù)。 下圖是一個(gè)典型的JTOL的mask模板。
SL3000B高速誤碼儀配置和選型指南
